Takuya Kojima

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Nakamura-Takase Laboratory, Graduate School of Information Science and Engineering, The University of Tokyo

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小島 拓也

東京大学 情報理工学系研究科 システム情報学専攻 中村・高瀬研究室

研究対象


経歴

学歴

研究歴

職歴

資格


奨学金

  1. 日本学生支援機構 大学院第一種奨学金 特に優れた業績による全額返還免除 (2019)

外部資金

受賞

  1. IEEE CEDA AJJC Design Gaia Best Poster Award (2019)
  2. IEICE CPSY 研究会優秀若手発表賞 (2018)

共著の受賞

  1. IEICE CPSY 研究会優秀若手発表賞 (2020)

研究業績 (抜粋)

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論文誌

  1. Takuya Kojima, Ayaka Ohwada, Hideharu Amano, “Mapping-aware Kernel Partitioning Method for CGRAs Assisted by Deep Learning”, IEEE Transactions on Parallel and Distributed Systems. DOI: 10.1109/TPDS.2021.3107746. [Early access]

  2. Takeharu Ikezoe, Takuya Kojima, Hideharu Amano, “Recovering faulty Non-volatile Flip Flops for Coarse-Grained Reconfigurable Architectures”, IEICE Transactions on Electronics, Vol.E104-C, No.6, pp.215-225, Jun. 2021. DOI: 10.1587/transele.2020LHP0002.

  3. 小島拓也, 池添赳治, 天野英晴, “3次元積層SiPを用いたマルチコアシステムのためのサイクルアキュレートシミュレータCubeSimの開発”, 電子情報通信学会論文誌D, Vol.J104-D,No.04,pp.-,Apr. 2021. DOI: 10.14923/transinfj.2020PDP0046. [Paper]

  4. Takuya Kojima, Nguyen Anh Vu Doan, Hideharu Amano, “GenMap: A Genetic Algorithmic Approach for Optimizing Spatial Mapping of Coarse Grained Reconfigurable Architectures”, IEEE Transactions on Very Large Scale Integration Systems (VLSI), Vol. 28, no. 11, pp.2383-2396, Nov 2020. DOI: 10.1109/TVLSI.2020.3009225. [IEEE Xplore] [Tool available at Github]

  5. Takuya Kojima, and Hideharu Amano, “A Fine-Grained Multicasting of Configuration data for Coarse-Grained Reconfigurable Architectures”, IEICE Transactions on Information and Systems, Vol.E102-D,No.7,pp.1247-1256,Jul. 2019. DOI:10.1587/transinf.2018EDP7336. [Paper]

  6. Takuya Kojima, Naoki Ando, Hayate Okuhara, Ng. Anh Vu Doan and Hideharu Amano, “Optimization of Body Biasing for Variable Pipelined Coarse-Grained Reconfigurable Architectures”, IEICE Transactions on Information and Systems, Vol.E101-D, No.6, pp.1532-1540, Jun 2018. DOI: 10.1587/transinf.2017EDP7308. [Paper]

国際学会 (査読付き)

  1. Takeharu Ikezoe, Takuya Kojima, and Hideharu Amano, “A Coarse-Grained Reconfigurable Architecture with a Fault Tolerant Non-volatile Configurable Memory”, 2019 International Conference on Field-Programmable Technology (FPT),Tianjin, China, December, 2019.

  2. Takuya Kojima, Naoki Ando, Yusuke Matsushita and Hideharu Amano, “Demonstration of Low Power Stream Processing Using a Variable Pipelined CGRA”, 29th International Conference on Field Programmable Logic and Applications (FPL), Barcelona, Spain, September, 2019. (Demo Paper) [Paper] [Poster]

  3. Takuya Kojima and Hideharu Amano, “A Configuration Data Multicasting Method for Coarse-Grained Reconfigurable Architectures”, 28th International Conference on Field Programmable Logic and Applications (FPL), Dublin, Ireland, August, 2018. [Paper] [Poster]

  4. Takuya Kojima, Naoki Ando, Yusuke Matsushita, Hayate Okuhara, Nguyen Anh Vu Doan and Hideharu Amano, “Real Chip Evaluation of a Low Power CGRA with Optimized Application Mapping”, International Symposium on Highly-Efficient Accelerators and Reconfigurable Technologies (HEART2018), Canada, June, 2018. [Paper] [Slide]

  5. Takuya Kojima, Naoki Ando, Hayate Okuhara, Hideharu Amano, “Glitch-aware Variable Pipeline Optimization for CGRAs”, ReConFig 2017, Mexico, December 2017. [Paper] [Poster]

  6. Takuya Kojima, Naoki Ando, Hayate Okuhara, Ng. Anh Vu Doan, Hideharu Amano, “Body Bias Optimization for Variable Pipelined CGRA”, 27th International Conference on Field-Programmable Logic and Applications(FPL), Belgium, September 2017. [Paper] [Poster]

国内研究会

  1. 大和田彩夏, 小島拓也, 天野英晴, “LLVMを用いたCGRA向けソフトウェア開発環境の構築と評価”, ETNET 2020, 与論町中央公民館, 鹿児島, 2020年2月. (若手発表賞受賞)

  2. 小島拓也, 天野英晴, “CGRAのためのアプリケーションマッピングフレームワークGenMapの実装と実機評価”, デザインガイア2019 -VLSI設計の新しい大地-, 愛媛県男女共同参画センター, 愛媛, 2019年11月. [Paper][Poster](IEEE CEDA AJJC Design Gaia Best Poster Award)

  3. 小島拓也,安藤尚樹, 松下悠亮, 奥原 颯, Nguyen Anh Vu Doan, 天野英晴, “可変パイプラインを持つ低消費電力アクセラレータCCSOTB2によるストリーム処理”, 萌芽的コンピューターシステム研究会, 飛騨地域地場産業振興センター, 岐阜, 2018年11月. [Paper] [Poster] (若手発表賞受賞)

謝辞

本研究の一部は, JSPS科研費 基盤研究S 25220002、JSPS科研費 基盤研究B 18H03215、JSPS科研費 特別研究員奨励費 19J21493、科学技術振興機構戦略的研究推進事業(JST), CREST, JPMJCR19K1の助成を受けたものです。 また、本研究の一部は,東京大学大規模集積システム設計教育研究センターを通し、シノプシス株式会社および日本ケイデンス株式会社の協力で行われたものである。